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Timing Specifications
Read Mode
Table 3.3 Read Cycle Timing 1
MR0D08B
Enable low to output active
Enable high to output Hi-Z
Parameter
Read cycle time
Address access time
Enable access time 2
Output enable access time
Output hold from address change
3
Output enable low to output active 3
3
Output enable high to output Hi-Z 3
Symbol
t AVAV
t AVQV
t ELQV
t GLQV
t AXQX
t ELQX
t GLQX
t EHQZ
t GHQZ
Min
45
-
-
-
3
3
0
0
0
Max
-
45
45
20
-
-
-
15
15
Unit
ns
ns
ns
ns
ns
ns
ns
ns
ns
1 
W is high for read cycle. Power supplies must be properly grounded and decoupled, and bus contention conditions must be 
minimized or eliminated during read or write cycles.
  Addresses valid before or at the same time E goes low.
2
3 
This parameter is sampled and not 100% tested. Transition is measured ±200 mV from the steady-state voltage.
Figure 3.3A Read Cycle 1
t AVAV
A (ADDRESS)
t AXQX
Q (DATA OUT)
Previous Data Valid
Data Valid
t AVQV
NOTE: Device is continuously selected (E ≤ V IL , G ≤ V IL )
Figure 3.3B Read Cycle 2
t AVAV
A (ADDRESS)
E (CHIP ENABLE)
G (OUTPUT ENABLE)
t AVQV
t ELQX
t ELQV
t EHQZ
Q (DATA OUT)
Everspin Technologies       ? 2011
t GLQX
9
t GLQV
Data Valid
t GHQZ
MR0D08B Rev. 3, 12/2011
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